GM8775C规格书，MIPI转LVDS，MIPI转双路LVDS分享

TEL13530609500 · 发表于 2022-7-28

1 产品概述

GM8775C 型DSI 转双通道 LVDS 发送器产品主要实现将MIPI DSI 转单/双通道 LVDS 功能，MIPI 支持 1/2/3/4 通道可选，最大支持 4Gbps 速率。LVDS 时钟频率最高154MHz，最大支持视频格式为 FULL HD（1920 x 1200）。

该芯片主要应用于手持设备、双屏显示，大屏幕显示等应用需求。

2 产品特征

a） I/0 电源电压：1.8V /3.3V；

b） core 电源电压：1.8V；

c）支持 MIPI® D-PHY 1.00.00 和 MIPI® DSI 1.02.00。

d） MIPI 支持 1/2/3/4 通道可选的传输方式，最高速率1Gbps/通道。

e） MIPI 接收 18bpp RGB666 、24bpp RGB888 、16bpp RGB565 的打包格式。

f） MIPI 支持 LPDT 传输（Low-Power Data Transmission）和反向 LPDT 传输。

g） LVDS 的时钟范围为 25MHz 到 154MHz。

h） LVDS 输出支持单/双通道模式。选择双通道模式时，可配置输出为 18/24bit，JEIDA/VESA 模式；选择单通道时，每通道可同时输出，且可单独配置输出模式 (18/24bit，JEIDA/VESA 模式）。

i） LVDS 的输出数据通道可灵活调整顺序以方便PCB 布线。

j）可选择采用 MIPI 时钟或外部参考时钟做 LVDS 输出的参考频率，且支持自动校准功能。

k）支持 MIPI commandmode 配置和外部 I2C配置两种芯片配置方式；

l） GPO可以输出PWM信号，控制屏幕背光。

m）封装 : QFN48-pins with e-pad.

n）工作温度：-40℃~85℃；

o） ESD 能力：≥2KV。

3 产品功能框图

图 1 功能结构图

功能框图按图 1 规定。本器件主要由 DSI 接收通道、数据缓冲、锁相环、LVDS 信号打包、LVDS TX 等模块组成，实现将1/2/3/4 通道的 DSI 图像信号转换成单/双通道 LVDS 信号输出的功能。

4 封装及引脚功能说明

本器件采用 48 引线的方形扁平无引脚（QFN48）封装。外形如下所示：

单位为毫米

, _1 U- `: @$ j4 J# T$ w: M5 d 尺寸符号	数值
, _1 U- `: @$ j4 J# T$ w: M5 d 尺寸符号	最小	公称	最大
A 7 l) w; y% w) i% ~ }+ h& b+ r' r " D' e. U& @/ r6 g5 \|* j. Q# }	5 ~* C- t7 u8 U / ^% T/ x$ X8 P' K0 c 0.70 7 U4 G9 [6 X7 {$ t9 e1 T/ l, u# ?4 Y- O% t$ W	( C9 y8 F! e) Z ( o1 ^( Z1 T" c7 h( n; F" e ― ; W! `/ p7 ~" q8 _% w2 z0 {0 c1 [' _$ g" _3 M1 W; F% A	1 E# a! E8 N4 d4 z1 e4 ? 2 U) l6 f0 G {) c) M5 h( L6 w 0.80 2 z# j0 _3 l# Y2 @& }$ W z ) o0 V4 A5 G/ A' M* u5 {1 M' @4 \
9 o5 x+ P" d. J$ w9 g7 z ! O, `2 W+ {9 R& @2 O# ? A1 6 Q8 ~& l1 @# W+ T1 a+ L% \% l. d) R& \|* q8 v	& N! T' d( t7 }) K/ q9 N! F: x, R$ d2 q J 0 4 w( ?6 W0 z9 l2 e% n$ j 5 q$ }/ C- G3 k, i	# k- `9 b [ D5 } d# E0 q1 {6 R 3 M$ q" B8 c- o7 R3 H' v% L6 d ― / m! \# o! u/ S& \|" y0 s( ] $ g7 Z0 f2 O2 M) X3 Z! c' s! H	( }' t0 g2 @# d$ _: I: J/ Q D( b$ D ( S9 f4 f4 R; _' h 0.05 # N7 J) f0 f1 j" ` , }3 u, q8 _* m) g: [1 D
2 d( X, H' _% b- x, ~9 Q$ }. k , H3 @7 f! ]# w/ \|3 F b $ R8 `4 N/ p4 g1 o2 n9 Z3 z; K" ?6 M5 p' \|7 l	! j6 @( [' \|8 S) a2 L( P8 r/ q2 b2 Y : c5 p8 `! x+ z9 R5 Z 0.18 9 i0 `% @! {- [ N 8 f+ l! ~% ^, T H	3 ^0 m2 h) E7 [1 M; G: Q& c$ K& y9 c5 k0 i) C& ^. }" X; b ― " t1 C% s u* W ) c6 I0 X. n& z. _( `% l	/ s! W; k1 L' p a3 l) c' v & F6 l" N2 R8 D 0.30 2 E: _7 g) [# ? S7 O' Q/ ?- }# j G3 J. Z
' I) ^1 m# n8 M& j # C! [+ C5 s5 \|. _* G- ]+ M# W6 ` c ( ^! \) s& }' ~8 C) O, a \ ! d) \|6 g$ `5 m7 A	, V, l) Z' i" @- L * q" f: K$ ~, N) R9 f 0.18 " a. n, O" J5 d# {4 D, \|7 O" o% J7 i5 L$ W	( H7 Z8 i1 h' O H0 R , P( a! p8 k5 Y/ Q/ V' ~6 @ ― . R' w( i# c6 O* I1 p3 {' } 0 S8 T- d8 l7 }8 q! R4 b+ q: h! x2 f	8 W, o; j6 f! j0 ~* T $ Z3 o" J9 H+ N8 ^7 s' g- \| 0.23 8 ^0 T9 v% e; N# K7 p' }8 W% S % d$ M. i) U( s2 B) S1 x6 D N
J. i ^$ J: p4 L % Y! d; O& L5 ^/ K! h1 L D , L5 u. u7 X$ J1 i* h% z& _/ Y ( T1 H! a8 M$ q( l$ A	% V5 }9 h* J& k5 W 9 ]+ A; j5 i3 c. R1 g# \|' _ ― 8 d1 Y+ A7 b; J7 ]$ v8 w7 J$ g ! `) x9 ?% ?; W; Z7 ?, w4 H2 A	0 g0 a9 e; d9 i# s% T4 _ ( X% Z5 d( o. M" ?& C2 V ― & p4 [" I4 S7 \: J T3 _$ q: j9 e# r3 Z	8 c0 T" P0 e8 v1 M, C! N7 B9 _+ ^: O ? 7.10 % }9 D# s$ ]7 Y8 T+ N , e7 b4 m5 [! ]9 P+ J! @1 D) M
& Z. b0 i( E' P7 f8 G! A 8 C. T1 P/ l/ G8 T2 o- @ E / L# E. r9 b; g9 \5 N2 H, x* O( G+ D' W	8 u6 X8 t7 ]7 G0 `( `* I 4 }7 {+ u e6 L# a' o' P/ Q ― 4 v- E2 f* G4 s* G4 Y , z1 h. b) r; O$ w3 L1 {	/ \' D5 x% A- s7 }3 y# g* d! j % r$ Z+ T, Q, j. S+ z ― ( h/ K8 E4 l1 s; P( \|5 W6 \|, m( h5 }( k	: [9 f! a4 g9 A: D 5 h2 J% l' N& W% ^; c* L R 7.10 $ z* T/ O o/ I 6 {0 j. N" y, }! u" J1 `
. \|" A+ J! s+ s! C q( ] ! Q4 w4 I% \7 C3 \|, P e - P/ t1 R2 Y. y# c- \|; ^. a5 [+ d' P& J! L, o3 S$ a	- \|5 ~1 L- t! F4 T& i * }. c/ o. B2 X ― , C. j4 p$ W# j$ U 8 w) g6 @- u) o: t	4 q. B x: d5 n) i 5 X/ w& @2 g2 w; v7 g 0.50 ( a* R9 C" W2 X1 j/ {* Y9 o 9 X3 Z9 }, y" X Q' U% G- `7 m	7 v0 @. d v" p/ j 6 G+ d2 F5 I7 M) Q$ V ― 1 s5 d( b) ?) j6 o: p( \/ h7 X& z& P* \|; I3 `
; o/ C j+ V2 c* z" l" r, [- x ( y& O) y. l6 a Q D2 6 R" z- W' y3 L) u4 B( n. X0 E3 W	7 `! {- ^2 U+ Z! S $ h$ Y- k4 E4 ? f. @# \" n 5.30 9 l9 ]$ i+ N: n8 s , n. V# O- F( u2 [+ \( ]! x	# [ n, T4 r% Y2 q9 Y( E' c6 e- o* D# X4 @) \ ― " b* b/ o) J, r1 q3 `5 H& i 6 x/ s+ G. Q& X: X( `9 ]3 `	. y. v7 ^8 i& M a& M- x& i 1 }5 O" f" h$ T: b 5.50 9 c# J5 w( }3 N. D- z0 @ ^; {" `: R* J# B
8 M, i3 {" M+ r; X% X. H* ^6 ~6 ?. v) b/ B6 g% G6 B E2 . O, P9 N- `: L3 X* a0 B5 I 6 {& N: C1 }2 P	0 z- H# C/ J+ I4 E( K - X: L9 Z; p8 o# o# i e 5.30 5 ~0 P4 ]" G+ B2 ]/ u0 m+ B/ N0 s7 x/ n4 @( n' E	3 C; O$ @# W& V# ]* U \|0 n" j ) x7 V; g w# i3 Q9 T9 v ― % x& w: {) j/ ^* a) T5 {* n" [ 4 \|7 U' p6 q5 ?/ W% H	: S* f2 S. m+ T7 N1 a0 M0 \|; ~ 2 @3 d7 M z+ n& S1 v# k 5.50 + X9 i( u+ c: ~3 i$ G% D+ z! ] 0 ]) @9 l. _9 T5 k _; e
. E$ {- ^4 E* V1 J2 [! ]0 r , @- d3 J- X9 ^; t! o* B8 J# h L ' a. Y2 b# p, \|4 F& ? $ \1 E4 v0 s! v N1 j7 p) _6 b% }3 }	7 m1 B* H- ^6 z$ S' O 0.35 6 g% f0 V" _8 C* i' L / j" p+ l. ^4 `	! B, R0 ~ r, b8 e( E% }9 u4 I4 h# o" o( ^ ― T' c- r! ?! B. M+ D3 j. E) k/ A# v	- f: T4 J0 f9 \|+ m( X. D* @/ k3 [ * K* }# }0 s4 x9 M* E: f+ f5 G 0.45 " Y8 p; f7 [* N# d0 {2 j: z9 W! ^$ T & V8 r- e# D% J3 k2 ^
% o+ M& W S& a3 Y6 C! c! e: C ! U% R, [9 U" r5 N$ d Z * ]9 q n; d/ j2 {- T$ v 1 G& a5 C/ z C Q	& }) K W6 w" r% w( H 8 p* P! \|& q' r9 R% j, U ― : \|% D- ]3 m. q1 n# ?7 c $ Q" i* M8 \! q' J' _	8 K( }4 Z3 v8 N- ]( V! Q& m! }# v x4 D: y7 _+ u2 q% x" M m( F* \|# R 0.75 ) Y! [( t. c5 O/ f1 W$ ~ + T' V* @2 x: _	& N" O# q8 D! c& C 8 e* @3 B$ D6 g/ t8 a ― 8 B0 }8 _% X) c; p2 q ) v* \|% l" E1 P$ ?* j$ e/ u: ]

图 2 外壳外形

引出端排列如下所示：

芯片的引脚功能详细说明：

表 1 引脚功能说明

引脚号	引脚名称	IO 方向	功能说明
MIPI 输入端口
14/15	DA0P/ DA0N	In	MIPI DSI 数据 0 通道差分输入正/负端
16/17	DA1P/ DA1N	In	MIPI DSI 数据 1 通道差分输入正/负端
20/21	DA2P/ DA2N	In	MIPI DSI 数据 2 通道差分输入正/负端
22/23	DA3P/ DA3N	In	MIPI DSI 数据 3 通道差分输入正/负端
18/19	DACP/ DACN	In	MIPI DSI 时钟差分输入正/负端
LVDS 输出端口
34/33	A_Y0P/A_Y0N	Out	A 通道 LVDS 数据 0 路差分输出正/负端
32/31	A_Y1P/A_Y1N	Out	A 通道 LVDS 数据 1 路差分输出正/负端
30/29	A_Y2P/A_Y2N	Out	A 通道 LVDS 数据 2 路差分输出正/负端
26/25	A_Y3P/A_Y3N	Out	A 通道 LVDS 数据 3 路差分输出正/负端
28/27	A_CLKP/A_CLKN	Out	A 通道 LVDS 时钟差分输出正/负端
48/47	B_Y0P/B_Y0N	Out	B 通道 LVDS 数据 0 路差分输出正/负端
46/45	B_Y1P/B_Y1N	Out	B 通道 LVDS 数据 1 路差分输出正/负端
44/43	B_Y2P/B_Y2N	Out	B 通道 LVDS 数据 2 路差分输出正/负端

40/39	B_Y3P/B_Y3N	Out	B 通道 LVDS 数据 3 路差分输出正/负端
42/41	B_CLKP/B_CLKN	Out	B 通道 LVDS 时钟差分输出正/负端
数字及控制端口（TTL 电平）
1	SCL	InOut	I2C Master/Slave 的 SCL 管脚
2	SDA	InOut	I2C Master/Slave 的 SDA 管脚
# N" g# S4 v/ P# H( ^ 8	! a! D: ?. X, M3 u4 W5 l4 M# k I2C_TYPE	( n, p5 q& z* q" n# y, m( u; R- Q In	高：SCL/SDA 为 Master，上电复位后自动读取外部 EEPROM的内容，EEPROM 地址为 0xA0；低：SCL/SDA 为 Slave
3 w; R! G. o9 { . z: v& V" \7 ]8 Q; q+ \8 H+ y 7	! O. z" T+ C2 b+ o 7 M/ n: V9 r2 }3 c* B1 K I2C_ADDR	) W9 ]5 f/ w+ b: ~) y( _' U . s M. `3 C# {& f" M7 n a In	1）当 I2C_TYPE 为低时，该芯片的 I2C 地址为：（1） I2C_ADDR 为高, 芯片 I2C 地址为 0x5A；（2） I2C_ADDR=Low, 芯片 I2C 地址为 0x58； 2）当 I2C_TYPE 为高时，外部 EEPROM 的地址为 0xA0。
6	IRQ	Out	通过寄存器配置输出信号
3	GPO_0	Out	通过寄存器配置输出信号
4	GPO_1	Out	通过寄存器配置输出信号
9	RESERVE	In	保留管脚，接地。
; e. ]( e; O, \2 ?; y. o 12	. _+ o7 S( k5 ^ EN	, }2 v+ C4 e* b+ y; { In	芯片使能控制输入端： 1）为高时，芯片正常工作； 2）为低时，芯片进入关断状态。
* b3 n% N# n; ^! x 24	7 U: F6 y/ C& z, S REFCLK	In	外部参考时钟输入管脚。当不用该管脚的参考时钟时，该管脚接 GND。
电源端口
35/38	VDD_LVDS	Power	1.8V LVDS 电源，电源纹波≤±100mV
36	VDD_PLL	Power	1.8V PLL 电源，电源纹波≤±100mV
10	VDDIO	Power	1.8V/3.3V I/O 电源,与 VDD_RX 电压相同，电源波动≤10%
1 H+ a0 v" G1 B! U- `2 t: I! g3 R 13	2 T- [- h& K8 F: k VDD_RX	4 l3 s( B9 f$ Q3 E4 V' z Power	1.8V/3.3VMIPI 电源，与 VDDIO 电压相同，电源纹波≤± 10%
% ?' n! i1 I5 H# T$ [$ O 11	6 y. r# T# w' h Vcore	* U) W3 i% _) A; L# ^$ \; E Power	芯片内部 1.2V 电源，该管脚必须接到地电容。电容至少为一个 0.1uF 和一个 1uF 并联。
37	VSS_PLL	GND	PLL 地。
5	GND	GND	VDDIO 地。
DAP	GND	GND	芯片地

TEL13530609500 · 发表于 2022-8-26

好的产品。好的方案，支持一下，

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